Electrical Power Systems Simulation Package de dSPACE
Simulation temps réel simple de circuits électroniques de puissance développés avec Simscape Electrical™
L’Electrical Power Systems Simulation Package de dSPACE permet de simuler en temps réel des modèles électriques développés sous Simscape Electrical™ (Specialized Power Systems).
- Simulation temps réel des circuits Simscape Electrical™ (anciennement SimPowerSystems™) pour les applications HIL
- Approche basée sur le FPGA pour la simulation à faible latence jusqu’à un pas de simulation de 400 ns
- Approche basée sur le processeur pour la simulation à latence modérée jusqu’à un pas de simulation de 25 μs
Domaines d’application
Le package Electrical Power Systems Simulation Package de dSPACE permet de simuler en temps réel des modèles électriques développés sous Simscape Electrical™ (Specialized Power Systems). Ce package offre plusieurs possibilités d’intégration des modèles Simscape Electrical™ (Specialized Power Systems) dans un environnement Hardware-In-the-Loop (HIL) dSPACE, p. ex. pour tester les éléments suivants :
- Stations de recharge et chargeurs embarqués
- Convertisseurs DC/DC
- Redresseurs actifs et onduleurs industriels
- Convertisseurs d’énergie éolienne ou solaire
- Réseaux intelligents
L’approche basée sur FPGA implique la configuration d’une application FPGA clés en main en fonction du modèle Simscape Electrical™ (Specialized Power Systems). Cela permet une simulation HIL avec des latences faibles. Dans le cadre de l’approche basée sur processeur, une bibliothèque d’extension est disponible pour modifier un modèle Simscape Electrical™ (Specialized Power Systems) et permettre la génération de code capable de fonctionner en temps réel sur des processeurs temps réel dSPACE via Simulink Coder™.
Avantages majeurs
Pour la simulation basée sur FPGA, il existe des applications FPGA préconfigurées qui facilitent l’intégration sans passer par l’étape chronophage de synthèse FPGA. De plus, aucune connaissance et aucun logiciel spécifique au FPGA ne sont nécessaires. Pour la simulation basée sur processeur, il existe des modèles à valeur moyenne pour différents montages en pont utilisés dans l’électronique de puissance pour garantir une simulation précise des dispositifs de commutation pour semi-conducteur de puissance. Les fonctions de la bibliothèque facilitant l'intégration de systèmes à échantillonnage multiple évitent les effets d'interférence.
La vitesse de ces deux types de simulation est augmentée grâce au calcul préalable des états du modèle. Grâce à cette séparation du modèle, la solution vous permet d’utiliser simultanément plusieurs plates-formes temps réel dSPACE pour le calcul. Une fonction oscilloscope intégrée vous permet de faire l’acquisition des signaux haute fréquence dans la période d’horloge du FPGA. En outre, divers outils d'analyse pratiques vous permettent d'examiner votre modèle en ce qui concerne la stabilité, les combinaisons de commutateurs et la capacité FPGA.
Caractéristiques uniques
Pour faciliter la simulation de topologies grandes et complexes, l’EPSS Package contient les fonctions multiprocesseurs et multiFPGA les plus avancées. L'outil de séparation de modèles semi-automatiques vous permet de trouver une position de fractionnement stable et optimale sans connaissances expertes. Par conséquent, vous pouvez facilement configurer des systèmes multiprocesseurs et multiFPGA en utilisant des cœurs individuels, des processeurs ou plusieurs cartes FPGA. Cette fonctionnalité peut considérablement accélérer les simulations en offrant une option de calcul parallèle et un échange de données haute performance entre les plates-formes de simulation individuelles. De plus, vous pouvez affecter les cartes E/S et les connexions inter-FPGA par programmation graphique. Grâce à l’intégration fluide du package dans la chaîne d’outils dSPACE, vous pouvez facilement étendre la fonctionnalité aux modèles XSG établis et aux modules de charge haute tension.
| Functionality | Description |
|---|---|
| General |
|
| FPGA-based approach – low-latency simulation down to a step size of 400 ns |
|
| Processor-based approach – for mid-latency simulation down to a step size of 25 μs |
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